全球领先的电子设计创新企业Cadence设计系统公司最近宣布了其新版本Allegro®TimingVision™environment高速接口设计高达67%。使用Cadence®AllegroPCBDesigner中的TimingVisionenvironment，高速可以大大缩短PCB接口设计周期，确保接口信号满足时间要求。先进的主流协议包括DDR3/DDR4、PCIExpress及SATA随着数据传输速率的提高和供电电压的降低，这一功能将变得越来越重要。

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TimingVisionenvironment采用嵌入式时序引擎分析整个接口结构和开发时序目标，帮助设计师直接Layout实现可视化的实时延迟和相位信息。这大大降低了手动编辑和整体实现的时间。当结合CadenceSigrity™power-aware的SI分析工具，TimingVisionenvironment能够快速分析和调整符合标准的接口设计，减少修复时间问题的时间。

TimingVisionenvironment非常适合任何高速接口PCB，特别适用于PC、平板电脑、智能手机和云数据中心架构应用。其主要功能包括：

·TimingVisionenvironment在设计信号和相关信号提供动态反馈

·自动交互相位调整(AiPT)静态和动态相位约束补偿选定组的差异

·自动交互式延迟调整(AiDT)补偿所选组的信号，如字节通道物理设计指定的传播延迟、相对传播延迟和总蚀刻长度约束。

“用这个新的Allegro技术可以结束我们花在布线和调整时间上的所有挫折。我们团队节省的所有时间都可以直接用于企业新项目的需求。”Pegatron计算机辅助工程副主任计算机辅助工程副主任SkyHuang表示。

“Cadence从芯片到最终产品的所有高速公路都处于独特的位置IP实现和验证需求，”Cadence研发副总裁AJIncorvaia表示，“引进TimingVisionenvironment，PCB设计师现在有了成熟高效的解决方案来满足需求Allegro中国官网时序收敛挑战日益复杂。”

TimingVisionenvironment与自动交互布线环境一起作为自动交互布线环境AllegroPCBHigh-SpeedOption目前已上市。